叙述：AD8582-+5伏并行输入完整双12位DAC

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●完整的双12位DAC
●外部组件
●单+5伏操作
●1mV位，满标度为4095V
●真电压输出，±5mA驱动
●极低功率：5mW
应用
●数字控制校准
●便携式设备
●伺服控制
●过程控制设备
●PC外围设备
一般说明
AD8582是一个完整的并行输入、双12位、电压输出DAC，用于在单个+5伏电源下运行。该单片DAC采用CBCMOS工艺构建，为用户提供了低成本，易于在仅+5伏的系统中使用。
除了DAC之外，芯片上还包括轨到轨放大器、锁存器和参考。参考（VREF）被微调为25伏输出，片上放大器将DAC输出增益到4095伏满量程。用户只需要提供+5伏电源。
AD8582采用自然二进制编码。运算放大器输出从0伏摆动到+4095伏，每位分辨率为1毫伏，能够驱动±5毫安。输出负载电流小于1毫安时，可以低至43伏运行。
高速并行数据接口连接到比较的处理器，没有等待状态。双缓冲输入结构允许用户一次加载一个输入寄存器，然后与LDA+LDB输入绑定的单个加载选通将同时更新两个DAC输出。LDA和LDB也可以单独激活，以立即更新其各自的DAC寄存器。当芯片选择CS输入被选通时，地址输入对DACA或DACB进行解码。异步复位输入将输出设置为零刻度。当重置输入被控制时，MSB位可用于将预设值设置为中标度。
AD8582有24针塑料DIP和表面贴装SOIC-24两种。每个部件都完全指定在-40°C至+85°C的温度范围内运行，并且整个+5V±5%的电源范围。
操作
AD8582是一个完整的、即用型的双12位数模转换器。操作只需要一个+5V电源。它包含两个电压开关、12位、激光修整的数模转换器、一个曲率校正的带隙基准、轨到轨输出运算放大器、输入寄存器和DAC寄存器。并行数据接口由12个数据位DB0-DB11、一个地址选择引脚AB、两个负载选通引脚（LDA、LDB）和一个低CS选通引脚组成。此外，异步RST引脚将把所有DAC寄存器位设置为零，导致VOUT变为零伏，或者在MSB引脚编程为逻辑1时，将VOUT设置为模拟应用的中等规模。此功能可用于上电重置或系统故障恢复到已知状态。
DA转换器部分
内部DAC是一个12位电压模式器件，其输出从AGND电势摆动到25伏内部带隙电压。它使用由N沟道MOSFET切换的激光修整R-2R梯形图。DAC的输出电压具有与数字输入码关的恒定电阻。DAC输出（用户不可用）内部连接到轨对轨输出运算放大器。
放大部分
内部DAC的输出由低功耗精密放大器缓冲。这种低功率放大器包含一个差分PNP对输入级，提供低偏移电压和低噪声，以及放大零标度DAC输出电压的能力。轨对轨放大器的增益配置为16384（=4095V25V），以设置4095V满标度输出（1mVLSB）。
运算放大器的典型稳定时间为16μs，达到001%。负回转信号和正回转信号的稳定时间略有不同。请参阅本数据表典型性能部分的示波器照片。
输出部分
该放大器的轨对轨输出级用于在靠近电源工作时提供精确的性能。显示了轨对轨放大器的等效输出示意图，其N沟道下拉FET将输出负载直接拉到GND。输出源电流由P通道上拉器件提供，该器件可以为GND端接负载供电，在475伏的-5%电源容差值下尤为重要。除了电阻负载驱动能力外，该放大器还经过精心和表征，具有高达500pF的电容负载驱动能力。
参考剖面
内部25V曲率校正带隙电压基准经过激光微调，以现初始精度和低温度系数。参考产生的电压在VREF引脚处可用。由于VREF不是用来驱动外部负载的，因此必须对其进行缓冲。绕过VREF引脚将提高噪声性能；然而，正常操作不需要旁路。
电源
AD8582的极低功耗是电路化使用CBCMOS工艺的直接结果。通过利用CMOS的低功耗特性进行逻辑运算，以及互补双极晶体管道的低噪声、紧密匹配，现了良好的模拟精度。
对于对功耗敏感的应用，重要的是AD8582的内部功耗强烈依赖于DB0-DB11、CS、AB、MSB、LDA、LDB和RST引脚上存在的际逻辑输入电压电平。由于这些输入是标准的CMOS逻辑结构，它们根据际的驱动逻辑VOH和VOL电压电平贡献静态功耗。因此，为了获得比较佳的功耗，CMOS逻辑与TTL相比在静态下提供了比较小的功耗。DB0-11引脚上的NL=0V提供了+5V电源典型的1mA的比较低待机功耗。
与任何模拟系统一样，建议在包含芯片的同一PC卡上绕过AD8582电源。当使用纹波频率为100kHz及以上的高频开关电源时，应考虑到这一点。
AD8582中使用的轨对轨输出放大器的一个点是可用电源电压范围广。该部件在+475V至+525V的温度范围内进行了充分的规定和测试。如果可以容忍接近满量程的线性度和电源电流能力降低，AD8582的工作电压可以低至+43V。
定时和控制
输入寄存器是电平触发的，在CS为低的时间段内从数据总线获取数据。所选的输入寄存器由AB选择引脚决定，完整说明见表I。当CS变高时，数据被隔离到寄存器中并保持，直到CS低电平。在CS高电平之前，数据出现在总线上所需的比较短时间称为数据设置时间（tDS），如时序图所示。数据保持时间（tDH）是CS运行后数据必须保留在总线上的时间。AD8582提供的高速定时提供了直接接口，除了比较的微处理器外，所有微处理器都没有等待状态
输入寄存器的数据通过低电平LDA和LDB引脚传输到DAC寄存器。如果将这些输入连接在一起，单个逻辑输入可以执行DAC寄存器的双缓冲更新，从而同时将模拟输出电压更改为新值。如果LDA和LDB引脚的布线为低电平，则它们将变得透明。在此模式下，输入寄存器数据将直接控制输出电压。
单极输出操作
这是AD8582的基本操作模式。AD8582的目的是以500pF的并联功率驱动低至820?的负载。